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在高速电路设计中，如何应对PCB设计中信号线的跨分割

EETOP · 公众号 · 硬件 · 2017-08-25 12:45

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这是一个HDI的项目，非常的密集，很多点都会出现跨分割，在设计之初，针对DDR3，经过仿真之后，觉得问题不大，所以设计工程师和我交流的时候，告诉他没有问题，结果一拿过来review的时候，傻眼。这哪是跨分割，简直就是分割嘛。来回在gap上绕线或者差分线有一根单线直接布在gap上，十有八九会造成问题，不是SI的问题，就有可能造成PI的问题，或者EMI的问题。

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